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ALUNO: JULIANO MARTINS DA SILVA

HIERARQUIAS PDH e SDH

QUADROS PCM-30

O que é PCM: É uma técnica que consiste em transformar sinais analógicos em um sinal digital, e vice-versa, para ser enviado por um meio de transmissão.
PCM ou MCP-30 é um multiplexador de 30 canais utilizando a tecnologia PCM/TDM (multiplexação por código de pulso/multiplexação por divisão no tempo) operando a umataxa de 2M bit/s transmitida via terrestre com repetidores. Destina-se a interligar centrais telefônicas em áreas urbanas e metropolitanas
É um sistema de 32 canais utilizado no Brasil, que também pode receber as seguintes denominações:
* PCM-30
* MCP-30
* PCM - 2 Mbps
* PCM - lei “A”
* PCM padrão europeu

SINCRONISMO EM PDH

Uma rede de sincronismo consiste em distribuirtempo e frequência sob uma rede de relógios, espalhando-se por toda uma extensa área. O objetivo desta é alinhar as escalas de tempo e frequência para todos os relógios, utilizando a capacidade de comunicação dos circuitos interconectados à rede existente.
Na rede PDH o sincronismo é necessário para que não ocorram “slips” (deslizamentos) periódicos, uma vez que o quadro não permite o ajuste davelocidade de cada tributário. Portanto é necessário que os sinais de 64 Kbits/s sejam síncronos ao quadro de 2 Mbits/s, e estes síncronos entre si.
Na multiplexação de sinais superiores a 64 Kbits/s (2, 34, 140 e 565 Mbits/s) torna-se necessário a sincronização dos sinais plesiócronos, através do mecanismo de justificação positiva. Este processo consiste na inserção de sinais redundantes emintervalos de tempo específicos para isto, denominados de bits de justificação, como mostra a figura, por exemplo, da estrutura de 8 Mbits/s.

Para a sincronização dos sinais de cada tributário de entrada (plesiócronos), é realizado o armazenamento dos sinais de cada tributário em uma memória elástica. A escrita nesta memória é sequencial, comandada pelo relógio de escrita de 2048 Khz (recuperado dopróprio feixe); e a leitura desta memória, também sequencial, é realizada através do relógio de 2112 Khz de leitura (relógio interno do equipamento multiplex).
Como o relógio de leitura tem frequência maior que o relógio de escrita, para evitar superposição de bits, estes dois relógios são comparados entre si, e, havendo necessidade para uma sincronização entre ambos, são inseridos espaços vagosno relógio de leitura, ou seja, há uma paralização na operação de leitura da memória elástica.
Esta operação é denominada de mecanismo de justificação positiva, o que evita os erros de leitura da memória elástica.
Este mecanismo de justificação é mostrado na figura a seguir:

Na recepção, os quatro sinais síncronos que compõem o sinal composto são transformados novamente em sinaisplesiócronos. Estes sinais são obtidos através de circuitos PLL (Phase Locked Loop), possuindo características de filtros passa-baixas, eliminando possíveis jitter de alta frequência.
A seguir tem-se uma tabela mostrando algumas das principais características da hierarquia PDH nos níveis de 8, 34 e 140 Mbits/s:

Velocidade daLinha | bits porQuadro | bits Alinhamento | duraçãodo quadro | bits I porquadro | bits Ipor tributário | velocidadedotributário | tolerânciadotributário |
8448 | 848 | 12 | 100,37 s | 820 | 205 a 206 | 2042 a 2052 | 50 ppm |
34362 | 1536 | 12 | 44,70 s | 1508 | 377 a 378 | 8433 a 8456 | 30 ppm |
139264 | 2904 | 16 | 20,85 s | 2864 | 716 a 717 | 34336 a 34384 | 20 ppm |

Todos estes parâmetros são característicos de todos os equipamentos de multiplexaçãopara redes PDH.
A seguir temos uma figura demonstrativa das hierarquias que compõem os equipamentos PDH:

Padrão Europeu x Americano

Tendo em vista as diferenças entre os sistemas PDH europeu, americano e japonês, torna-se difícil a interligação desses sistemas num sistema de comunicação digital mundial unificado. Esse fato, além de outros fatores (como a dificuldade de conseguir altas taxas...
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